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數字電路實訓心得體會
當我們有一些感想時，往往會寫一篇心得體會，這樣我們可以養成良好的總結方法。是不是無從下筆、沒有頭緒？以下是小編為大家整理的數字電路實訓心得體會，希望能夠幫助到大家。
數字電路實訓心得體會1
電路實訓，作為一門實實在在的實訓學科，是電路知識的基礎和依據。它可以幫助我們進一步理解鞏固電路學的知識，激發我們對電路的學習興趣。在大二上學期將要結束之際，我們進行了一系列的電路實訓，從簡單基爾霍夫定律的驗證到示波器的使用，再到一階電路—————，一共五個實訓，通過這五個實訓，我對電路實訓有了更深刻的了解，體會到了電路的神奇與奧妙。不過說實話在做這次試驗之前，我以為不會難做，就像以前做的實訓一樣，操作應該不會很難，做完實訓之后兩下子就將實訓報告寫完，直到做完這次電路實訓時，我才知道其實并不容易做。它真的不像我想象中的那么簡單，天真的以為自己把平時的理論課學好就可以很順利的完成實訓，事實證明我錯了，當我走上試驗臺，我意識到要想以優秀的成績完成此次所有的實訓，難度很大，但我知道這個難度是與學到的知識成正比的，因此我想說，雖然我在實訓的過程中遇到了不少困難，但最后的成績還是不錯的，因為我畢竟在這次實訓中學到了許多在課堂上學不到的東西，終究使我在這次實訓中受益匪淺。
下面我想談談我在所做的實訓中的心得體會：
在基爾霍夫定律和疊加定理的驗證實訓中，進一步學習了基爾霍夫定律和疊加定理的應用，根據所畫原理圖，連接好實際電路，測量出實訓數據，經計算實訓結果均在誤差范圍內，說明該實訓做的成功。我認為這兩個實訓的實訓原理還是比較簡單的，但實際操作起來并不是很簡單，至少我覺得那些行行色色的導線就足以把你繞花眼，所以我想說這個實訓不僅僅是對你所學知識掌握情況的考察，更是對你的耐心和眼力的一種考驗。
在戴維南定理的`驗證實訓中，了解到對于任何一個線性有源網絡，總可以用一個電壓源與一個電阻的串聯來等效代替此電壓源的電動勢Us等于這個有源二端網絡的開路電壓Uoc，其等效內阻Ro等于該網絡中所有獨立源均置零時的等效電阻。這就是戴維南定理的具體說明，我認為其實質也就是在闡述一個等效的概念，我想無論你是學習理論知識還是進行實際操作，只要抓住這個中心，我想可能你所遇到的續都問題就可以迎刃而解。不過在做這個實訓，我想我們應該注意一下萬用表的使用，盡管它的操作很簡單，但如果你馬虎大意也是完全有可能出錯的，是你整個的實訓前功盡棄！
在接下來的常用電子儀器使用實訓中，我們選擇了對示波器的使用，我們通過了解示波器的原理，初步學會了示波器的使用方法。在試驗中我們觀察到了在不同頻率、不同振幅下的各種波形，并且通過毫伏表得出了在不同情況下毫伏表的讀數。
總的來說，通過此次電路實訓，我的收獲真的是蠻大的，不只是學會了一些一起的使用，如毫伏表，示波器等等，更重要的是在此次實訓過程中，更好的培養了我們的具體實訓的能力。又因為在在實訓過程中有許多實訓現象，需要我們仔細的觀察，并且分析現象的原因。特別有時當實訓現象與我們預計的結果不相符時，就更加的需要我們仔細的思考和分析了，并且進行適當的調節。因此電路實訓可以培養我們的觀察能力、動手操做能力和獨立思考能力。
數字電路實訓心得體會2
數字電路又可稱為邏輯電路，通過與（&），或（>=1），非（o），異或（=1），同或（=）等門電路來實現邏輯。
邏輯電路又可分為組合邏輯電路和時序邏輯電路。組合邏輯電路是指在某一時刻的輸出狀態僅僅取決于在該時刻的輸入狀態，而與電路過去的狀態無關。
TTL和CMOS電路：TTL是晶體管輸入晶體管輸出邏輯的縮寫，它用的電源為5V。CMOS電路是由PMOS管和NMOS管（源極一般接地）組合而成，電源電壓范圍較廣，從1。2V—18V都可以。
CMOS的推挽輸出：輸出高電平時N管截止，P管導通；輸出低電平時N管導通，P管截止。輸出電阻小，因此驅動能力強。
CMOS門的漏極開路式：去掉P管，輸出端可以直接接在一起實現線與功能。如果用CMOS管直接接在一起，那么當一個輸出高電平，一個輸出低電平時，P管和N管同時導通，電流很大，可能燒毀管子。單一的管子導通，只是溝道的導通，電流小，如果兩個管子都導通，則形成電流回路，電流大。
輸入輸出高阻：在P1和N1管的漏極再加一個P2管和N2管，，當要配置成高阻時，使得P2和N2管都不導通，從而實現高阻狀態。
靜態電流：輸入無狀態反轉（高低電平變換）情況下的電流。
動態電流：電路在邏輯狀態切換過程中產生的功耗，包括瞬間導通功耗和負載電容充放電功耗兩部分。門電路的`上升邊沿和下降邊沿是不可避免的，因此在輸入電壓由高到低或由低變高的過程中到達Vt附近時，兩管同時導通產生尖峰電流。該損耗取決于輸入波形的好壞（CMOS工藝），電源電壓的大小和輸入信號的重復頻率。電路的負載電容的充放電也是很大的一部分。
ESD保護：Electro—Staticdischarge， 靜電放電。
輸入輸出緩沖器：是緩沖器，不是緩存器，就是一個CMOS門電路。輸入緩沖器的作用主要是1，TTL/CMOS電平轉換接口；2，過濾外部輸入信號噪聲。輸出緩沖器的作用是增加驅動能力。
配成輸入模式不一定比輸出模式更省電：輸入模式時輸入緩沖器會打開，而輸出模式時輸出緩沖器會打開。
TESEO上GPIO數據寄存器讀寫的注意點：
配置成普通GPIO時，如果配置成輸出口，那么寫數據寄存器會直接輸出該電平，讀數據寄存器實際就是讀鎖存器中最后一次被寫入的值。如果被配置成輸入口，并且上下拉使能的話，那么寫數據寄存器就是配置上下拉電阻，而讀數據寄存器就是讀輸入引腳的緩沖器，返回的是該引腳的當前電平狀況。有些平臺會有專門的狀態寄存器，無論當前引腳被配置成輸入還是輸出，讀該專門的狀態寄存器都返回該引腳的當前電平狀況。
引腳的BOOT state是指在上電重啟或硬重啟時引腳的狀態，reset release之后的狀態為reset state，reset state和state有可能不一樣。TESEO的UART0_TX為boot1，該引腳的信號在上電重啟或硬重啟時會被鎖存，以備reset release時給default register map用。
IO的電源電壓配置：IO引腳歸屬于不同IOring，不同的IO ring可以被輸入不同的電壓。CPU在判決IO的邏輯電平時會和IO ring的電平（乘以高低電平的系數）作比較。
數字電路中的擺幅：輸入擺幅和輸出擺幅。輸入擺幅指的是最低輸入高電平和最高輸入低電平的差值，輸出擺幅指的是最低輸出高電平和最高輸出低電平之間的差值，TTL的擺幅偏小。
在時序邏輯電路里，如果輸入的時鐘停止，那么整個電路的功耗很低，原因是時序邏輯電路里的很多小單元的輸出是由時鐘驅動的，時鐘停止，基本就是高阻態。如果將整個模塊的電斷了，那么就會更加省電。
串口通信電路，如果將其關掉，一般RX線上會是低電平，如果檢測到高電平，就會產生中斷，這個時候就可以重啟開啟串口，但是第一個字節由于不在串口寄存器里面，因此，數據會丟失。
數字電路實訓心得體會3
這次實驗是本學期第一次數電實驗，本以為電路圖，原理功能都已經給了，只要按步驟來就會很容易的焊出要求的電路板，于是買好了器件，畫好了原理圖，就開始一個人開工了，但由于沒有焊電路板和布線的豐富經驗，訓練也不足，雖然自己一個人很受打擊的焊完第一塊，但是最后什么結果都沒有，查了一遍電路，也許是因為自己弄的原因也找不出毛病在哪，真的是非常痛苦非常折磨啊，于是干脆心一狠，這次和同組的毛同學一起焊，吸取了上次的教訓，不能再閉門造車，這次要取百家之長，于是我先去實驗室看了一下已經弄好的同學的電路板，看他們的布線和版面布局，然后又問了老師很多在第一塊失敗的電路板出現的問題。經過老師解答我知道了一般布線是在電路板正面只有布不下的時候才會在背面布線，而我上次就全在背面布線，到時整個電路線路十分混亂也不易于檢查，于是這個決定在正面布線，然后我們倆畫好了實物鏈路連接圖，一切就緒，就差開始動工了！
由于第一次的失敗，很受打擊所以這次電線的`連接和焊接就交給了比我細心的毛同學來完成，我則負責對電路的時時檢查和改進意見，最后經過兩天的緊張焊接（加起來5，6個小時）終于完成了，但這次發現開關應有的作用沒有起到，于是我們開始檢測，發現跳過開關環節可以出現結果，于是確定毛病出現在開關上，我們用萬用表檢查了開關功能，果然是引腳電路有問題，于是我們進行了開關的功能測試，最后將16個開關全部拆下來，又按招正確的單刀雙置介入電路板，終于這個問題解決了！
這是又測試發現10，11數碼沒有實現加6功能，經過邏輯分析發現問題出在芯片74LS00上于是我們對電線連接做了全面檢查，沒有問題，我懷疑是芯片問題，于是拆下芯片一看，果然在將芯片插入底座是有一個芯片管腳懸空導致一直是高電平輸出，于是重新插入，終于第一塊板子大功造成！
真是心情愉悅啊。
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